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[디지털 시스템 설계 및 實驗(실험)] Latch, Flip-Flop, Shift Register

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작성일 23-03-11 11:57

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output Q,Q_;
and (AD,D,NR);

1. SR NOR latch

dl dl2 (Q1,C,Q,Q_);

코딩

module dppr(D,C,R,Q,Q_);

설명

2. Gated D latch(based on an SR NOR latch)
3. (Master?slave pulse-triggered) D flip-flop (with reset)

4. 4-bit shift register(using 4 D flip-flops)

디지털 시스템 설계,Latch, Flip-Flop, Shift Register
시뮬레이션

endmodule
[디지털 시스템 설계 및 實驗(실험)] Latch, Flip-Flop, Shift Register

not (NC,C);

input D,C,R;

(Master&slave pulse-triggered) D flip-flop (with reset)

wire Q1,Q1_;
순서
not (NR,R);
1. SR NOR latch 2. Gated D latch(based on an SR NOR latch) 3. (Master?slave pulse-triggered) D flip-flop (with reset) 4. 4-bit shift register(using 4 D flip-flops)

wire NR;
wire AD;
dl dl1 (AD,NC,Q1,Q1_);

레포트 > 공학,기술계열

다.

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